DACに使用するIV変換の検討 （３）
さてさて、止まっていたDACのIV変換のつづきです。
ざっと、回路を基板レイアウトに落とし込み、基板の試作です。
この週末、ちょっと進みがわるかったので、ここまで。
若干、TR数が多いですね。 これで１回路分ですから、4倍の数が必要になってきます。
まともに動くかどうか・・・ 実は、Spiceシミュレーション上では、なぜか発振しています。
ただ、私の野生の勘としては、発振せずに動くのではないかと思っています。
んまあ、発振したらしたで、何かしらの対策をすれば良い訳だし。 と、お気楽な気分で挑もうかと思っています。
どうなるのでしょうか。
私としては、この試作でDCの安定度を見極めたいです。
ベース接地入力でカレントフィードバックな回路は、超ハイスピード動作が期待できますが、さすがに作ったことがないので、未知のエリアへと突入ですね。
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コメント
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楽しみです。
投稿: ま。 | 2013年12月 9日 (月) 09時03分
ま。さん
私も、久しぶりの新回路で楽しみです。 少しTR数が多いのが気になります。
１回路あたり１１個。 ４回路で４４個ものトランジスタが必要になってしまいます・・・
投稿: たかじん | 2013年12月 9日 (月) 20時06分
たかじんさん
確か、ベース接地で受けて、カレントミラーで折り返して、バッファ、という話だったかと思います。
カレントミラーのところ、“？”と首を傾げましたが、回路図書いて納得しました。一応、ワイドラー型カレントミラーの変形（？）なのですね。ベース電流を補償するトランジスタを利用して、１石節約している。
＋側の定電流回路は、－側のコンプリメンタリで構成しているのですね。＋側の構成、とても勉強になりそうです。
＋側に入っている半固定抵抗は、出力のＤＣオフセット調節用でしょうか。
とりあえず、回路定数は異なると思いますが、Spiceで、AC解析をする限りでは発振していなそうでした。過渡解析を深くはやっていませんが1kHzでは発振しませんでした。
私の適当な回路定数でも、（無負荷）歪率は、0.014%が出ました。たかじんさんオリジナルなら、１桁下がるでしょう。凄いポテンシャルを秘めた回路なのだろうと思います。（DACの出力がどうなっているとか詳しくないので、入力した交流電流は適当です。）
たかじんさんの、野生の勘というか、経験からくる直感がどうなるのか、わくわくしてきました。
投稿: 若輩者 | 2013年12月 9日 (月) 21時58分
電流帰還アンプの帰還RにCをパラにするならほかで初段に局部帰還をかけないと安定しないのではありませんか?
投稿: hen | 2013年12月 9日 (月) 21時59分
たかじんさんこんばんわ。ご無沙汰しております。
野生な技術者、ステキですｗ
ぱっと聞いただけでは、とても安定が難しそうな感じがしますが、こういう回路にチャレンジするのもいいですね。DC帰還をどうやってするのかとても興味を惹かれます。
投稿: i6502 | 2013年12月 9日 (月) 23時08分
若輩者さん
すばやいシミュレーションありがとうございます。 カレントミラーは、ウイルソン型と呼ばれるタイプです。 ＴＲのひとつをダイオードに置き換えています。
2次歪みは-120dBくらいですね。 3次が-130ｄＢ程度。 差動合成で2次は打ち消し合います。 ３次は加算される見込みです。
henさん
電流帰還で帰還抵抗にＣを入れるのはタブーですよね（笑
さすが良く判っていらっしゃる。 たまにはこういう挑戦もよいでしょう。 撃沈して別の回路を考える必要が出てくるかもしれません。
i6502さん
ＤＣ安定度は、差動回路がない時点で、全くのぞめません。
その辺を見極めたいのですよね。 シミュレーションではわかりづらい部分です。 特定ＴＲを手で触って暖めたりしてどのくらいドリフトするのか実際に電圧を測りながらテストするのがいいんです。 昔ながらの手法です。 そうやってちょっとＴＲに触れただけで発振するようだったらどこかに問題があるという事もわかりますし。
投稿: たかじん | 2013年12月 9日 (月) 23時49分